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  • MAX12557型高速A/D转换器的特点及应用

    diffclk/seclk(18)是选择输入时钟方式。diffclk/seclk=gnd,选择单端时钟输入;diffclk/ seclk=ovdd,选择差分时钟输入。 clkn、clkp(19、20)是时钟输入。在差分时钟输入模式下,将差分时钟接在clkp和clkn之间;在单端时钟输入模式下,将时钟接在clkp,clkn接地。 div2、div4(21,22)是采样时钟2/4分频模式选择。 d0a-d13a、d0b-d13b(45-58,28-41)是通道a、b的14位coms数字输出。 dora、dorb(59,42)是通道a、b数据溢出指示。当通道a、b逻辑输入电压超出范围时,dora/dorb数字输出发出溢出指示信号。当dora/dorb为1时,超出范围;当dora/dorb为0时,没有超出范围。 dav(44)是输出数据有效指示。dav上升沿表示当前数字输出端数据有效。 g/t(64)是输出格式选择。当接地时,选择输出格式

  • MAX12557的原理设计和布局指导

    3 d6a channel a cmos digital output, bit 6 54 d7a channel a cmos digital output, bit 7 55 d8a channel a cmos digital output, bit 8 56 d9a channel a cmos digital output, bit 9 57 d10a channel a cmos digital output, bit 10 58 d13a channel a cmos digital output, bit 11 (msb) 59 dora channel a data out-of-range indicator. the dora digital output indicates when the channel a analog input voltage is out of range. dora = 1: digital outputs exceed full-scale range.dora = 0: d

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