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1 引言 随着数字信号处理技术的不断发展，大容量可编程逻辑器件的不断涌现，fpga技术越来越多地应用在大规模集成电路设计中。在此硬件系统设计中，经常会遇到需要大容量的数据存储的情况，下面我们将针对fpga中内部block ram有限的缺点，提出了将fpga与外部sram相结合来改进设计的方法，并给出了部分vhdl程序。 2 硬件设计 这里将主要讨论以xilinx公司的 fpga（xc2s600e-6fg456）和issi公司的sram（is61lv25616al）为主要器件来完成大容量数据存储的设计思路。 fpga即现场可编程门阵列,其结构与传统的门阵列相似,大量的可编程逻辑块(clb, configurable logic block)在芯片中央按矩阵排列,芯片四周为可编程输入/输出块(iob, input/output block),clb行列之间及clb和iob之间具有可编程的互连资源(icr, inter connect resource)。clb、iob和icr都由分布在芯片中的sram静态存储单元控制,sram中的数据决定fpga的功能,这些数据可以在系统加电时自动或由命令控制从外部存储器装入 。
30针的双排针脚式接口将120个重要的引脚引出，可以分配给地址线、数据线、ad模块和时钟电源等。在这里，具体的引脚外接就不再详述了，只介绍几个常用的外扩模块电路。当然，在对最小系统的利用时，可以增加相应的模块来完成特定的功能，例如可以增加rs-485通信电路，在扩展的同时要注意用dc-dc进行物理隔离，尤其在工业应用场合。 1.5.1 外扩ram电路和外扩flash电路 为了增加系统的程序存储空间，提高系统的工作效率，根据设计要求外扩了flash电路和ram电路。选用的ram 型号为is61lv25616al，256 kb×16 bit大小。这里用了a0~a17共18根地址线，最大为256 kb；d0~d15 共16 根数据线。片选cs6和读写wr、rd 信号都由dsp引出。外扩的flash型号为sst39vf800，512 kb×16 bit，方便用户烧写较大程序。本文比sram多了1根地址线，所以最大可以达到512 kb，片选信号用cs2。具体连接如图6所示。 1.5.2 sci串口通信电路 在许多dsp的应用中都会使用到串行口与电脑的串行口相连接，进行数据的传输或控制命令的发送
示。其中tms320f2812最小系统中主要包括时钟电路、复位电路和外部存储器扩展电路。时钟电路采用外部时钟，选用一片30mhz晶振作为外部频率给定，外部时钟经过pll倍频后，为系统提供时钟，系统可以通过锁相环控制寄存器来选择锁相环的工作模式和倍频的系数。复位电路的设计，为了操作的方便，主要使用的是系统复位引脚（rs）。当接触开关s按下时，使得该引脚产生一个低电平，就会产生相应的复位信号；当接触开关s未动作时，该引脚为高电平。外部存储器扩展电路主要采用的issi公司生产的高速sram芯片，型号为is61lv25616al，存储时间为10ns，容量为256k字节，16位，工作电压为3.3v，工作于零等待工作模式。 3 硬件设计 控制系统的硬件设计主要是围绕主控制器tms320f2812进行的，tms320f2812的外围电路主要有ad采样电路和sci通信电路。 3.1 a/d采样电路 tms320f2812的adc模块是一个12位带流水线的模数转换器，共有16个通道。根据实际需要，本系统用到了9个ad转换通道adcin00～adcin08，需采样的信号分别是3个相电压、直流电压、3路线
有上电模式和sccb编程模式。本系统采用sccb编程模式，连续扫描，16位rgb数据输出。系统硬件结构框图如图1所示。 arm芯片选用具有arm7tdmi内核的lpc2210，通过lpc2210的gpio模拟sccb总线协议，控制ov7620的功能寄存器。使用lpc2210的3个中断引脚引入ov7620的图像输出同步信号vsync、hsync、pclk，以中断方式同步图像数据输出。ov7620的yuv通道输出的16位并行数据通过lpc2210的高16位数据线接入。sst39vf160和is61lv25616al为扩展的flash和sram，分别用作程序存储器和数据存储器。 2 具体实现 2．1 ov7620的功能控制 ov7620的控制采用sccb(seriai camera controlbus)协议。sccb是简化的i2c协议，sio-l是串行时钟输入线，sio-o是串行双向数据线，分别相当于i2c协议的scl和sda。sccb的总线时序与i2c基本相同，它的响应信号ack被称为一个传输单元的第9位，分为don’t care和na。don’t care位由从机产生；na位由主
重要参数(ip地址、矿井号等)的修改，外扩e2prom用于重要参数的存储。主控芯片 主控芯片采用arm7芯片lpc2292为主控芯片，其内部有16kb ram，并带有256kb嵌入式高速闪存存储器。lpc2292含有2路spi接口，满足操作以太网控制器enc28j60的要求，还含有2路内嵌can控制器，能够方便地实现can通信。由于嵌入了μc／os一ⅱ操作系统并移植了tcp／ip协议栈，lpc2292内部的16kb ram无法满足程序对存储空间的要求。因此，本设计在lpc2292外扩展了型号为is61lv25616al的ram，其存储空间512kb。tcp／ip通信模块 本文采用microchip公司spi接口的以太网控制器enc28j60，其最大传输速率为10mbps。enc28j60通过spi接口和lpc2292相连接，网络的四个引脚通过网络变压器后连接到rj45接口，两个中断引脚接单片机的外部中断或者连接到通用i／o口，两个指示灯引脚外接发光管连接到地或者电源，其余引脚是电源和地。图3为enc28j60接口电路图。网口插座采用内置网络变压器、状态显示灯和电阻网络的rj45接座hr911105a，具有信
我分析我分析：1、cpu是好的；2、jtag连接也正常；3、我在测量is61lv25616al与cpu的连接线路时也正常，那么唯一的可能是“is61lv25616al”坏了！！！各位高人请指点一下！！谢谢了先
lpc2210实验板上的mt45w4mw16可以直接用is61lv25616al直接代替吗lpc2210实验板上的sram——mt45w4mw16可以直接用is61lv25616al直接代替吗？对于原来在mt45w4mw16基础上写的程序现在有什么需要改变的吗？
是不是加载的问题啊在下初学arm，用lpc2220做了块板子，扩展了4mb的sram（is61lv25616al）和16mb的flash（sst39vf160）。编程时使用了ads的arm executeble image for lpc2200模板,写了一个简单的测试程序，用axd仿真时发生错误如下：no disassembly could be read at the requested address似乎我的程序根本就下载到sram中去，不知道是哪里的问题，哪位大虾可以解惑啊？先行谢过
上输出一个方波。用thumb c编译，循环体生成7条指令，方波宽度约1us。指令如下： ldr r1,[r0,#4] orr r1,r2 str r1,[r0,#4] ldr r1,[r0,#0xc] orr r1,r2 str r1,[r0,#0xc] b 0x80000744 ; (main + 0xc)感觉仍是比较慢，不知大家有何见解？2。更奇怪的是，我用arm c编译后，循环体生成11条指令。然后我量外部ram is61lv25616al的读脉冲（oe脚),发现在一个方波的时间内只有6个读脉冲（即6次低电平)。这是否意味着11条指令只需读六次ram？arm指令集是32位的，而ram是16位，所以11条指令应该读11×2＝22次才对。十分困惑，请解答,谢谢
输出引脚； 17,19管脚悬空；其他管脚接地。）8、 先验证cpu是否工作：1、读取id（拉低p0.14脚）；2、用片内ram仿真（1、下载2100模板，添加到自己计算机，例如：d:\arm\adsv1_2\stationery\；2、建立2100工程文件即可开始仿真；3、先点亮led，注意此处程序的延时需要“加大”，否则看不到“高低”变化）9、 cpu的id读取成功，说明“最小系统正常”、232芯片工作正常了；使用内部ram仿真成功说明jtag正常了；10、 然后焊接ram（is61lv25616al）开始外部仿真（用2200模板），只要线路连接没问题就会一次成功！如果不成功请仔细检查线路，是否连接、是否短路、断路！！！！先写这么多，等高手添加丰富内容，让更多的人能有所收获就够了！！！
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